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IDT71V3576, IDT71V3578, 128K x 36, 256K x 18, 3.3V Synchronous SRAMs with
3.3V I/O, Pipelined Outputs, Burst Counter, Single Cycle Deselect Commercial and Industrial Temperature Ranges
AC Electrical Characteristics
(V DD = 3.3V ±5%, Commercial and Industrial Temperature Ranges)
150MHz
133MHz
t CYC
t CH (1)
t CL (1)
Symbol
Clock Cycle Time
Clock High Pulse Width
Clock Low Pulse Width
Parameter
Min.
6.7
2.6
2.6
Max.
____
____
____
Min.
7.5
3
3
Max.
____
____
____
Unit
ns
ns
ns
Output Parameters
t CD
t CDC
t CLZ (2)
t CHZ (2)
t OE
t OLZ (2)
t OHZ (2)
Clo ck High to Valid Data
Clock High to Data Change
Clock High to Output Active
Clock High to Data High-Z
Output Enable Access Time
Output Enable Low to Output Active
Output Enable High to Output High-Z
____
1.5
0
1.5
____
0
____
3.8
____
____
3.8
3.8
____
3.8
____
1.5
0
1.5
____
0
____
4.2
____
____
4.2
4.2
____
4.2
ns
ns
ns
ns
ns
ns
ns
Set Up Times
t SA
t SS
t SD
t SW
t SAV
t SC
Address Setup Time
Address Status Setup Time
Data In Setup Time
Write Setup Time
Address Advance Setup Time
Chip Enable/Select Setup Time
1.5
1.5
1.5
1.5
1.5
1.5
____
____
____
____
____
____
1.5
1.5
1.5
1.5
1.5
1.5
____
____
____
____
____
____
ns
ns
ns
ns
ns
ns
Hold Times
t HA
t HS
t HD
t HW
t HAV
t HC
Address Hold Time
Address Status Hold Time
Data In Hold Time
Write Hold Time
Address Advance Hold Time
Chip Enable/Select Hold Time
0.5
0.5
0.5
0.5
0.5
0.5
____
____
____
____
____
____
0.5
0.5
0.5
0.5
0.5
0.5
____
____
____
____
____
____
ns
ns
ns
ns
ns
ns
Sleep Mode and Configuration Parameters
t ZZPW
t ZZR (3)
t CFG (4)
ZZ Pulse Width
ZZ Recovery Time
Configuration Set-up Time
100
100
27
____
____
____
100
100
30
____
____
____
ns
ns
ns
NOTES:
1. Measured as HIGH above V IH and LOW below V IL .
2. Transition is measured ±200mV from steady-state.
3. Device must be deselected when powered-up from sleep mode.
4. t CFG is the minimum time required to configure the device based on the LBO input. LBO is a static input and must not change during normal operation.
10
6.42
5279 tbl 16
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